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Git 工作流大师复盘沉淀与知识库更新
让Git 工作流大师把完成的任务沉淀为复盘、模板、检查清单和可复用知识。
Git 工作流大师交付物撰写与汇报
帮助Git 工作流大师把分析过程转成清晰、可交付、适合不同受众的汇报材料。
Git 工作流大师自动化提示词与工具调用清单
把Git 工作流大师的重复工作转成 TotalClaw-agent 可执行提示词、工具清单和检查步骤。
Git 工作流大师质量检查与风险复核
帮助Git 工作流大师在交付前检查质量、遗漏、风险、合规和用户预期偏差。
Git 工作流大师方案生成与备选比较
让Git 工作流大师生成多套方案，并从成本、收益、风险和执行难度进行比较。
Git 工作流大师信息收集与证据台账
指导Git 工作流大师收集资料、记录来源、判断可信度并形成可复查证据台账。
Git 工作流大师工作流规划与里程碑排期
为Git 工作流大师生成可执行工作流、里程碑、责任分工和节奏安排。
Git 工作流大师任务澄清与目标拆解
帮助Git 工作流大师把模糊需求拆成目标、边界、输入、验收标准和下一步行动。
前端开发者复盘沉淀与知识库更新
让前端开发者把完成的任务沉淀为复盘、模板、检查清单和可复用知识。
前端开发者交付物撰写与汇报
帮助前端开发者把分析过程转成清晰、可交付、适合不同受众的汇报材料。
前端开发者自动化提示词与工具调用清单
把前端开发者的重复工作转成 TotalClaw-agent 可执行提示词、工具清单和检查步骤。
前端开发者质量检查与风险复核
帮助前端开发者在交付前检查质量、遗漏、风险、合规和用户预期偏差。
前端开发者方案生成与备选比较
让前端开发者生成多套方案，并从成本、收益、风险和执行难度进行比较。
前端开发者信息收集与证据台账
指导前端开发者收集资料、记录来源、判断可信度并形成可复查证据台账。
前端开发者工作流规划与里程碑排期
为前端开发者生成可执行工作流、里程碑、责任分工和节奏安排。
前端开发者任务澄清与目标拆解
帮助前端开发者把模糊需求拆成目标、边界、输入、验收标准和下一步行动。
FPGA/ASIC 数字设计工程师复盘沉淀与知识库更新
让FPGA/ASIC 数字设计工程师把完成的任务沉淀为复盘、模板、检查清单和可复用知识。
FPGA/ASIC 数字设计工程师交付物撰写与汇报
帮助FPGA/ASIC 数字设计工程师把分析过程转成清晰、可交付、适合不同受众的汇报材料。
FPGA/ASIC 数字设计工程师自动化提示词与工具调用清单
把FPGA/ASIC 数字设计工程师的重复工作转成 TotalClaw-agent 可执行提示词、工具清单和检查步骤。
FPGA/ASIC 数字设计工程师质量检查与风险复核
帮助FPGA/ASIC 数字设计工程师在交付前检查质量、遗漏、风险、合规和用户预期偏差。
FPGA/ASIC 数字设计工程师方案生成与备选比较
让FPGA/ASIC 数字设计工程师生成多套方案，并从成本、收益、风险和执行难度进行比较。
FPGA/ASIC 数字设计工程师信息收集与证据台账
指导FPGA/ASIC 数字设计工程师收集资料、记录来源、判断可信度并形成可复查证据台账。
FPGA/ASIC 数字设计工程师工作流规划与里程碑排期
为FPGA/ASIC 数字设计工程师生成可执行工作流、里程碑、责任分工和节奏安排。
FPGA/ASIC 数字设计工程师任务澄清与目标拆解
帮助FPGA/ASIC 数字设计工程师把模糊需求拆成目标、边界、输入、验收标准和下一步行动。